Kritische Pfadverzögerung des Carry-Ripple-Addierers Taschenrechner

✖Die Ausbreitungsverzögerung bezieht sich typischerweise auf die Anstiegszeit oder Abfallzeit in Logikgattern. Dies ist die Zeit, die ein Logikgatter benötigt, um seinen Ausgangszustand basierend auf einer Änderung des Eingangszustands zu ändern.ⓘ Ausbreitungsverzögerung [t_pg]			+10% -10%
✖Gatter auf kritischem Pfad sind definiert als die Gesamtzahl der Logikgatter, die während einer Zykluszeit im CMOS benötigt werden.ⓘ Gates auf kritischem Weg [N_gates]			+10% -10%
✖Die Verzögerung des UND-ODER-Gatters in der grauen Zelle ist definiert als die Verzögerung der Rechenzeit im UND/ODER-Gatter, wenn die Logik durch dieses hindurchgeleitet wird.ⓘ UND-ODER-Gate-Verzögerung [T_ao]			+10% -10%
✖Die XOR-Verzögerung ist die Ausbreitungsverzögerung des XOR-Gatters.ⓘ XOR-Verzögerung [T_xor]			+10% -10%

✖Die Welligkeitszeit einer Carry-Ripple-Addierschaltung ist definiert als die berechnete Zeit der kritischen Pfadverzögerung.ⓘ Kritische Pfadverzögerung des Carry-Ripple-Addierers [T_ripple]

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Kritische Pfadverzögerung des Carry-Ripple-Addierers Lösung

SCHRITT 0: Zusammenfassung vor der Berechnung

Gebrauchte Formel

Ripple-Zeit = Ausbreitungsverzögerung+(Gates auf kritischem Weg-1)*UND-ODER-Gate-Verzögerung+XOR-Verzögerung
T_ripple = t_pg+(N_gates-1)*T_ao+T_xor
Diese formel verwendet 5 Variablen

Verwendete Variablen

Ripple-Zeit - (Gemessen in Zweite) - Die Welligkeitszeit einer Carry-Ripple-Addierschaltung ist definiert als die berechnete Zeit der kritischen Pfadverzögerung.
Ausbreitungsverzögerung - (Gemessen in Zweite) - Die Ausbreitungsverzögerung bezieht sich typischerweise auf die Anstiegszeit oder Abfallzeit in Logikgattern. Dies ist die Zeit, die ein Logikgatter benötigt, um seinen Ausgangszustand basierend auf einer Änderung des Eingangszustands zu ändern.
Gates auf kritischem Weg - Gatter auf kritischem Pfad sind definiert als die Gesamtzahl der Logikgatter, die während einer Zykluszeit im CMOS benötigt werden.
UND-ODER-Gate-Verzögerung - (Gemessen in Zweite) - Die Verzögerung des UND-ODER-Gatters in der grauen Zelle ist definiert als die Verzögerung der Rechenzeit im UND/ODER-Gatter, wenn die Logik durch dieses hindurchgeleitet wird.
XOR-Verzögerung - (Gemessen in Zweite) - Die XOR-Verzögerung ist die Ausbreitungsverzögerung des XOR-Gatters.

SCHRITT 1: Konvertieren Sie die Eingänge in die Basiseinheit

Ausbreitungsverzögerung: 8.01 Nanosekunde --> 8.01E-09 Zweite (Überprüfen sie die konvertierung hier)
Gates auf kritischem Weg: 11 --> Keine Konvertierung erforderlich
UND-ODER-Gate-Verzögerung: 2.05 Nanosekunde --> 2.05E-09 Zweite (Überprüfen sie die konvertierung hier)
XOR-Verzögerung: 1.49 Nanosekunde --> 1.49E-09 Zweite (Überprüfen sie die konvertierung hier)

SCHRITT 2: Formel auswerten

Eingabewerte in Formel ersetzen

T_ripple = t_pg+(N_gates-1)*T_ao+T_xor --> 8.01E-09+(11-1)*2.05E-09+1.49E-09

Auswerten ... ...

T_ripple = 3E-08

SCHRITT 3: Konvertieren Sie das Ergebnis in die Ausgabeeinheit

3E-08 Zweite -->30 Nanosekunde (Überprüfen sie die konvertierung hier)

ENDGÜLTIGE ANTWORT

30 Nanosekunde <-- Ripple-Zeit

(Berechnung in 00.004 sekunden abgeschlossen)

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Credits

Erstellt von Shobhit Dimri

Bipin Tripathi Kumaon Institut für Technologie (BTKIT), Dwarahat

Shobhit Dimri hat diesen Rechner und 900+ weitere Rechner erstellt!

Geprüft von Urvi Rathod

Vishwakarma Government Engineering College (VGEC), Ahmedabad

Urvi Rathod hat diesen Rechner und 1900+ weitere Rechner verifiziert!

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'XOR'-Verzögerung

LaTeX Gehen XOR-Verzögerung = Ripple-Zeit-(Ausbreitungsverzögerung+(Gates auf kritischem Weg-1)*UND-ODER-Gate-Verzögerung)

Kritische Pfadverzögerung des Carry-Ripple-Addierers

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N-Bit Carry-Skip-Addierer

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Kritische Pfadverzögerung des Carry-Ripple-Addierers Formel

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Ripple-Zeit = Ausbreitungsverzögerung+(Gates auf kritischem Weg-1)*UND-ODER-Gate-Verzögerung+XOR-Verzögerung
T_ripple = t_pg+(N_gates-1)*T_ao+T_xor

Welche Bedeutung hat der Carry-Skip-Addierer?

Ein Carry-Skip-Addierer ist eine Addiererimplementierung, die die Verzögerung eines Ripple-Carry-Addierers mit geringem Aufwand im Vergleich zu anderen Addierern verbessert. Die Verbesserung der Worst-Case-Verzögerung wird erreicht, indem mehrere Carry-Skip-Addierer verwendet werden, um einen Block-Carry-Skip-Addierer zu bilden. Im Gegensatz zu anderen schnellen Addierern wird die Leistung des Carry-Skip-Addierers nur mit einigen der Kombinationen von Eingangsbits erhöht. Dies bedeutet, dass die Geschwindigkeitsverbesserung nur probabilistisch ist.

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